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【2h】

Simultaneous Statistical Delay and Slew Optimization for Interconnect Pipelines

机译：互连管道的同步统计延迟和摆动优化

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Andrew Havlir; David Z. Pan;
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年度 2015
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机译：通过使用博弈论确定门的大小，同时实现互连延迟和串扰噪声优化
2. CMOS delay and power model equations for simultaneous transistor and interconnect wire analysis and optimization [J] . Lee S., Greeneich EW. VLSI Design . 2002,第3期

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3. CMOS Delay and Power Model Equations for Simultaneous Transistor and Interconnect Wire Analysis and Optimization [J] . SanghoLee, Edwin W.Greeneich VLSI Design . 2002,第3期

机译：用于同步晶体管和互连线的CMOS延迟和功率模型方程式分析和优化
4. Simultaneous statistical delay and slew optimization for interconnect pipelines [C] . Havlir A., Pan D.Z. Quality Electronic Design, 2006. ISQED '06 . 2006

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5. Systemwide intersectional signal timing optimization simultaneously minimizing vehicle and pedestrain delays. [D] . Roshandeh, Arash Moradkhani. 2013

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6. Statistical optimization of simultaneous saccharification fermentative hydrogen production from corn stover [O] . Yanyan Jing, Fang Li, Yameng Li, 2020

机译：玉米秸秆同时糖化发酵氢生产的统计优化
7. CMOS Delay and Power Model Equations for Simultaneous Transistor and Interconnect Wire Analysis and Optimization [O] . Sangho Lee, Edwin W. Greeneich 2002

机译：用于同时晶体管和互连线分析和优化的CmOs延迟和功率模型方程

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